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|
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vram
|
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R0
|
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R1
|
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|
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IKXXONS>@k4@GP6o<Rk0zM0
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|
||||
L0 4 18
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
!s107 /home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/rom.sv|
|
||||
!s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/rom.sv|
|
||||
R19
|
||||
Z24 !s107 rom.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/ByteIM.sv|
|
||||
R20
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
vseven_seg
|
||||
R0
|
||||
R1
|
||||
Z25 !s110 1793848696
|
||||
!i10b 1
|
||||
!s100 ^3LXNA>i`]oD>7BNB:Rd?3
|
||||
R2
|
||||
@@ -420,41 +470,41 @@ IedFU7?nB5ZOibY?bC8=L41
|
||||
R3
|
||||
S1
|
||||
R4
|
||||
R16
|
||||
R22
|
||||
8seven_seg.sv
|
||||
Fseven_seg.sv
|
||||
!i122 185
|
||||
!i122 207
|
||||
L0 3 23
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
Z19 !s107 seven_seg.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv|
|
||||
Z20 !s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv|
|
||||
Z26 !s108 1793848696.000000
|
||||
Z27 !s107 seven_seg.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv|
|
||||
Z28 !s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv|
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
vseven_seg_4digit
|
||||
R0
|
||||
R1
|
||||
R25
|
||||
!i10b 1
|
||||
!s100 MRn_YTIW^S4cR39n=0RMi0
|
||||
!s100 kl;BlN=e=UfChCC`DZJA01
|
||||
R2
|
||||
IYaD1MHdmne1KMOgV5M^f70
|
||||
IS1jLgB;Q?W`6]WHX6bTgl1
|
||||
R3
|
||||
S1
|
||||
R4
|
||||
w1791866874
|
||||
w1792119097
|
||||
8/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_4digit.sv
|
||||
F/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_4digit.sv
|
||||
!i122 184
|
||||
!i122 206
|
||||
L0 5 37
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
R26
|
||||
!s107 seven_seg.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_4digit.sv|
|
||||
!s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_4digit.sv|
|
||||
!i113 1
|
||||
@@ -462,7 +512,7 @@ R10
|
||||
R11
|
||||
vseven_seg_tb
|
||||
R0
|
||||
R1
|
||||
R25
|
||||
!i10b 1
|
||||
!s100 jPijM2]zTRBV8TFdD?Q`I1
|
||||
R2
|
||||
@@ -473,15 +523,15 @@ R4
|
||||
w1788418794
|
||||
8/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv
|
||||
F/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/seven_seg_tb.sv
|
||||
!i122 185
|
||||
!i122 207
|
||||
L0 3 66
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
R19
|
||||
R20
|
||||
R26
|
||||
R27
|
||||
R28
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
@@ -495,24 +545,24 @@ IzJzhQo`olGLa0f4lM55A42
|
||||
R3
|
||||
S1
|
||||
R4
|
||||
R16
|
||||
R22
|
||||
8shifter.sv
|
||||
Fshifter.sv
|
||||
!i122 187
|
||||
R17
|
||||
!i122 215
|
||||
R23
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
Z21 !s107 shifter.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv|
|
||||
Z22 !s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv|
|
||||
R7
|
||||
R8
|
||||
R9
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
vshifter_tb
|
||||
R0
|
||||
R1
|
||||
R25
|
||||
!i10b 1
|
||||
!s100 TiConQ4:_WTd:PLNNG`Po3
|
||||
R2
|
||||
@@ -520,18 +570,18 @@ Ia6ohf92lD=P<P]lDi667i2
|
||||
R3
|
||||
S1
|
||||
R4
|
||||
R14
|
||||
R17
|
||||
8/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv
|
||||
F/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv
|
||||
!i122 187
|
||||
!i122 209
|
||||
L0 2 76
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
R21
|
||||
R22
|
||||
R26
|
||||
!s107 shifter.sv|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv|
|
||||
!s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/shifter_tb.sv|
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
@@ -539,24 +589,24 @@ vsign_extender
|
||||
R0
|
||||
R1
|
||||
!i10b 1
|
||||
!s100 VOYzaEd320YMo:nYU=@hG2
|
||||
!s100 dXL[XDH1LfSe`PJjMiOTD2
|
||||
R2
|
||||
Ic?f[J?J3HD0]DeV]c1EoN3
|
||||
I0BX4cd5>`EdI:oOG868Jh2
|
||||
R3
|
||||
S1
|
||||
R4
|
||||
R15
|
||||
8/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/sign_extender.sv
|
||||
F/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/sign_extender.sv
|
||||
!i122 188
|
||||
L0 4 15
|
||||
w1792644107
|
||||
8sign_extender.sv
|
||||
Fsign_extender.sv
|
||||
!i122 215
|
||||
L0 4 12
|
||||
R6
|
||||
r1
|
||||
!s85 0
|
||||
31
|
||||
R18
|
||||
!s107 /home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/sign_extender.sv|
|
||||
!s90 -reportprogress|300|-work|work|-sv|-stats=none|/home/oliver/Documents/FPGA_Dev/FPGA_Uni/ModelSim/sign_extender.sv|
|
||||
R7
|
||||
R8
|
||||
R9
|
||||
!i113 1
|
||||
R10
|
||||
R11
|
||||
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